<span style="color:rgb(102,102,102); font-family:宋体,Arial; font-size:16px; line-height:26px">1.1 亚稳态发生原因</span>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 在FPGA系统中，如果数据传输中不满足触发器的Tsu和Th不满足，或者复位过程中复位信号的释放相对于有效时钟沿的恢复时间（recovery time）不满足，就可能产生亚稳态，此时触发器输出端Q在有效时钟沿之后比较长的一段时间处于不确定的状态，在这段时间里Q端在0和1之间处于振荡状态，而不是等于数据输入端D的值。这段时间称为决断时间（resolution time）。经过resolution time之后Q端将稳定到0或1上，但是稳定到0或者1，是随机的，与输入没有必然的关系。</p>
<span style="color:rgb(102,102,102); font-family:宋体,Arial; font-size:16px; line-height:26px">1.2 亚稳态发生场合</span>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 只要系统中有异步元件，亚稳态就是无法避免的，亚稳态主要发生在异步信号检测、跨时钟域信号传输以及复位电路等常用设计中。</p>
<span style="color:rgb(102,102,102); font-family:宋体,Arial; font-size:16px; line-height:26px">1.3 亚稳态危害</span>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 由于产生亚稳态后，寄存器Q端输出在稳定下来之前可能是毛刺、振荡、固定的某一电压值。在信号传输中产生亚稳态就会导致与其相连其他数字部件将其作出不同的判断，有的判断到“1”有的判断到“0”，有的也进入了亚稳态，数字部件就会逻辑混乱。在复位电路中产生亚稳态可能会导致复位失败。怎么降低亚稳态发生的概率成了FPGA设计需要重视的一个注意事项。</p>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> </p>
<span style="color:rgb(102,102,102); font-family:宋体,Arial; font-size:16px; line-height:26px">2. 理论分析2.1 信号传输中的亚稳态</span>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 在同步系统中，输入信号总是系统时钟同步，能够达到寄存器的时序要求，所以亚稳态不会发生。亚稳态问题通常发生在一些跨时钟域信号传输以及异步信号采集上。</p>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 它们发生的原因如下：</p>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> （1）在跨时钟域信号传输时，由于源寄存器时钟和目的寄存器时钟相移未知，所以源寄存器数据发出数据，数据可能在任何时间到达异步时钟域的目的寄存器，所以无法保证满足目的寄存器Tsu和Th的要求；</p>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> （2）在异步信号采集中，由于异步信号可以在任意时间点到达目的寄存器，所以也无法保证满足目的寄存器Tsu和Th的要求；</p>
<p style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom:0px; color:rgb(102,102,102); line-height:19px; font-size:13px; font-family:verdana,'ms song',宋体,Arial,微软雅黑,Helvetica,sans-serif; background-color:rgb(254,254,242)"> 当数据在目的寄存器Tsu-Th时间窗口发生变化，也即当数据的建立时间或者保持时间不满足时，就可能发生亚稳态现象。如图3.1所示。</p>
<p align="center" style="word-wrap:break-word; margin:5px auto; padding-top:0px; padding-bottom: |
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